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Overview of Diplomacy for writing effective hardware design language Chisel (Japanese) - RISC-V International

Un article sur l'utilisation de chisel avec le module diplomacy pour construire des SoC facilement.
Par contre c'est en Japonnais, il va falloir jouer du google trad !
Mon Jan 25 08:42:28 2021 - permalink -
- https://riscv.org/blog/2021/01/overview-of-diplomacy-for-writing-effective-hardware-design-language-chisel-japanese/

chisel diplomacy flf japon
icesugar-chisel

Des exemple chisel appliqués à la carte icesugar (ecp5).
Thu Dec 17 10:07:18 2020 - permalink -
- https://github.com/ekiwi/icesugar-chisel

chisel ecp5 flf
Chisel Serv

Un portage en Chisel du célèbre processeur risc-v de Olof : le serv
Tue Dec 15 08:44:28 2020 - permalink -
- https://github.com/ekiwi/serv-chisel

chisel flf serv
Analyseur de spectre en Chisel

Un analyseur de spectre écrit en Chisel
Fri Dec 11 08:46:02 2020 - permalink -
- https://github.com/milovanovic/spectrometer/tree/d8bddfc2d3727c3eb052c5833dee2a61e9cc2a4a

chisel flf hdl
Game boy to vga adapt first test - YouTube

Premier test de mon convertisseur GameBoy vers VGA avec une carte FPGA Fireant (Trion T8 de efinix).
Le tout écrit en Chisel -> https://github.com/Martoni/GbVga
Tue Nov 3 22:27:13 2020 - permalink -
- https://www.youtube.com/watch?v=K6CevdZVtT0

chisel efinix flf fpga gameboy Trion vga
Scastie

chisel 3.4.0 est sorti.
Thu Sep 24 20:30:10 2020 - permalink -
- https://scastie.scala-lang.org/A3mX5Ih8SPax4s2d2TqZEg

chisel flf fpga
TechTalk: RISC-V Single Cycle Core with Chisel Date Venue - YouTube

Développement d'un core RISC-V en Chisel par des Pakistanais.
Thu Jun 25 14:56:44 2020 - permalink -
- https://www.youtube.com/watch?time_continue=57&v=5PV5bYw8-Os&feature=emb_logo

chisel flf fpga pakistan riscv
Chisel 3.3.0

Sortie de Chisel 3.3.0
Fri May 8 12:27:58 2020 - permalink -
- https://github.com/freechipsproject/chisel3/releases

chisel flf release
Chisel a quick reference guide for beginner
Tue Apr 14 10:29:52 2020 - permalink -
- https://docs.google.com/viewer?a=v&pid=forums&srcid=MTQ0NzQ0ODU1OTAwNzkzMjE5NTQBMDE2MDg4MjA0NjQ2Njc2Mzc1MDUBaXpmWk1RR2NBQUFKATAuMQEBdjI&authuser=0

chisel chisel3 flf pdf reference-manual
ChiselWatt sur Colorlight 5A-75B

Le processeur 64bits au jeux d'instructions OpenPower tourne sur la carte ECP5 à $15.
Mon Feb 24 08:43:11 2020 - permalink -
- https://github.com/antonblanchard/chiselwatt/commit/5a7fcbc8142ed2b390e1f8bfaaa801fe09a60351

5A-75B chisel colorlight ecp5 flf openpower
chiselwatt

Un petit processeur POWER Open ISA écrit en Chisel. Il permet de faire tourner micropython.
Wed Feb 19 10:39:35 2020 - permalink -
- https://github.com/antonblanchard/chiselwatt

chisel flf micropython openpower python
A Chisel Backend for Timing Predictability - Mihail Asavoae

Tiens, le CEA semble s'intéresser à Chisel. Ils ont envoyé quelqu'un faire une présentation au CCC2020.
Et ils ont une offre de stage sur le sujet :
https://www.linkedin.com/jobs/view/1717229029/

La présentation sur le site officiel du CCC:
https://events.linuxfoundation.org/chisel-community-conference/program/schedule/
Wed Feb 12 10:36:30 2020 - permalink -
- https://drive.google.com/file/d/1_Cgqa3fUzamzoBp7mH6VcuuKvI74fO8v/view

cea chisel chisel3 flf
Text Editors · Metals

Scala ide plugin
Fri Feb 7 14:30:07 2020 - permalink -
- https://scalameta.org/metals/docs/editors/overview.html

chisel flf scala
Vim FIRRTL syntax config

To have beautiful colors in vim with FIRRTL
Fri Feb 7 14:28:50 2020 - permalink -
- https://github.com/azidar/firrtl-syntax

chisel chisel3 firrtl flf vim
Prove Chisel design with Yosys-smtbmc | Front de Libération des FPGA

Comment faire de la preuve formelle avec Chisel
Mon Feb 3 22:08:50 2020 - permalink -
- http://www.fabienm.eu/flf/prove-chisel-design-with-yosys-smtbmc/

chisel formal systemverilog verilog yosys-smtbmc
The Chisel Book

Version 2.0 du chisel book. Avec une version traduite en Chinois.
Fri Jan 31 09:44:11 2020 - permalink -
- http://www.imm.dtu.dk/~masca/chisel-book.html

chisel flf hdl livre
sbt 'show discoveredMainClasses'

Pour voir toutes les «main()» disponibles dans un répertoire sbt racine :

sbt 'show discoveredMainClasses'

Les main() sont en fait des classes qui étendent App :

class MyObj extends App {
}

Ce sont ces classes qui sont appelé quand on fait un :

sbt "runMain ..."
Thu Jan 30 14:54:24 2020 - permalink -
- https://pastebin.com/JsHc94Ev

chisel flf sbt
chisverilogutils: Chisel, Cocotb, smtbmc toolkit

If you are designing your gateware with Chisel-HDL and testing it with CocoTB, you will need some script like that.
- to add waveform under verilog TOP generated for Icarus simulation
- To generate all cocotb files for testing a Chisel module
- To inject some SystemVerilog code in verilog generated for Formal verification (assume/assert/cover/...)
Wed Jan 29 15:16:12 2020 - permalink -
- https://github.com/Martoni/chisverilogutils

chisel cocotb flf formal python smtbmc verilog
Bits, Bytes, and Gates: Chisel Sharpening: If it's not tested, it's broken

Si c'est pas testé, c'est cassé !
Sun Dec 15 14:30:56 2019 - permalink -
- https://bitsbytesgates.blogspot.com/2017/08/chisel-sharpening-verification.html

chisel flf hdl test
Chisel Tips | Front de Libération des FPGA

Initialize Vec() of Reg()
Thu Nov 7 13:48:02 2019 - permalink -
- http://www.fabienm.eu/flf/chisel-tips/#vec_reg_init

chisel flf tips

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