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Week 22 (2022年5月30日)

jigl - Générer une gallerie photo en HTML | Mon pense-bête
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VHDL Scalar Types – electgon
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cheatsheet vhdl flf
Vistepure sur Twitter : "@PoliceNationale Pas facile ce quiz... https://t.co/dZHDFE3qn3" / Twitter
metoo_cycliste vélo
Rust sur RP2040 | Mon petit coin de oueb

Manifeste pour un clignotement doux des LED ;)

rust LED rp2040
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Cerfia sur Twitter : "🇫🇷 INSOLITE | À #Marzy dans la #Nièvre, un poteau téléphonique déplacé par les orages est resté 10 jours au milieu de la route. Les habitants ont dénoncé le manque de réactivité de l'opérateur #Orange. (FranceInfo) #Bourgogne https://t.co/wpjBxn9ReJ" / Twitter
metoo_cycliste
une voiture sur Twitter : "Un comportement validé par @LeLynxfr" / Twitter
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Le Biclou (vacciné 3ème dose) 🇺🇦 👍 sur Twitter : "Ne pas rire. https://t.co/52UiKbsePc" / Twitter
metoo_cycliste
noasic/noasic: An open-source VHDL library for FPGA design.

Une librairie open-source en VHDL pour les FPGA

vhdl flf
Initiation au Machine Learning sur python avec SKlearn | Linux Embedded

Coude

sklearn machine-learning python
ZiyangYE/General-Slow-DDR3-Interface: A general slow DDR3 interface. Very little resource consumption. Suits for all FPGAs with 1.5V IO voltage.

Un contrôleur DDR3 ralenti pour être compatible avec n'importe quel FPGA. Même peu performant.
Écrit en SpinalHDL

flf spinalHDL ddr3