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Keysight Keysight UXR 110GHz BW, 256GS/s, 10-bit, 4-Channel Real-Time Oscilloscope Teardown & Experiments | The Signal Path

Démontage d'un oscilloscope à 1.3 millions de $ !
Mon 24 Sep 2018 08:29:36 PM CEST - permalink -
- http://thesignalpath.com/blogs/2018/09/18/keysight-keysight-uxr-110ghz-bw-256gs-s-10-bit-4-channel-real-time-oscilloscope-teardown-experiments/

geek oscilloscope porno vidéo électronique
[Cocotb] The future of Cocotb

Oyé oyé si vous souhaitez vous impliquer dans le développement de cocotb c'est maintenant !
Mon 24 Sep 2018 01:27:52 PM CEST - permalink -
- https://lists.librecores.org/pipermail/cocotb/2018-September/000023.html

cocotb orconf2018 python
Verilator 4.002 - LinuxFr.org

Nouvelle release majeur de verilator \o/
Mon 24 Sep 2018 08:50:41 AM CEST - permalink -
- https://linuxfr.org/news/verilator-4-002

flf verilator verilog
LSA - Libre Silicon Alliance

Déverrouillons la chaine de fabrication des composants silicium.
Sat 22 Sep 2018 09:14:19 PM CEST - permalink -
- https://libresilicon.com/

flf libresilicon qtflow
VIDEO. Au Royaume-Uni, les voitures à proximité des écoles, c’est fini

Superbe idée !
Fri 21 Sep 2018 10:18:08 AM CEST - permalink -
- https://www.francetvinfo.fr/economie/transports/trafic/video-au-royaume-uni-les-voitures-a-proximite-des-ecoles-cest-fini_2919513.html

rue vélo école
Git: How to delete all untracked files? - Super User

Pour virer tous les fichiers et répertoire non versionné dans git :
git clean -df
Thu 20 Sep 2018 05:27:30 PM CEST - permalink -
- https://superuser.com/questions/335496/git-how-to-delete-all-untracked-files

clean git
Covered - Verilog Code Coverage Analyzer

Couverture de code verilog.
Thu 20 Sep 2018 03:12:14 PM CEST - permalink -
- http://covered.sourceforge.net/

covered flf verilog
User Guide | Icarus Verilog | FANDOM powered by Wikia

Icarus verilog guide
Thu 20 Sep 2018 03:10:40 PM CEST - permalink -
- http://iverilog.wikia.com/wiki/User_Guide

flf manual verilator
Sebastien Kramm: State machine diagrams with Graphviz

Des machines d'états avec graphviz
Wed 19 Sep 2018 09:37:37 AM CEST - permalink -
- https://skramm.blogspot.com/2014/04/state-machine-diagrams-with-graphviz.html

flf graphviz statemachine
Chisel ready/valid
Tue 18 Sep 2018 02:52:06 PM CEST - permalink -
- http://www-inst.eecs.berkeley.edu/~cs250/fa13/lectures/lec11b.pdf

chisel flf fpga
Open Source Paramotor Using Quadcopter Tech | Hackaday

Un paramoteur électrique lowcost basé sur des moteurs de drônes.
Tue 18 Sep 2018 01:40:54 PM CEST - permalink -
- https://hackaday.com/2018/09/17/open-source-paramotor-using-quadcopter-tech/

drône hack moteur opensource parapente
math - Python: unsigned 32 bit bitwise arithmetic - Stack Overflow

Petite astuce en python pour faire un «not». Le symbole '~' inverse les bits d'un nombre ... sur 32bits signé !
Or on peut vouloir le faire sur un mot plus petit et surtout non signé. Pour cela il suffit de masquer le nombre avec des '1' de la longueur que l'on veut. Par exemple je veux inverser 0x01 sur 8bits :
In [26]: "{:08b}".format(0x01)
Out[26]: '00000001'

Si je fait simplement '~' je n’obtiens pas le résultat voulu :
In [27]: "{:08b}".format(~0x01)
Out[27]: '-0000010'

Si je masque avec 0xff (8 bits à '1') :
In [28]: "{:08b}".format(~0x01&0xff)
Out[28]: '11111110'

Ça marche.
Tue 18 Sep 2018 09:48:32 AM CEST - permalink -
- https://stackoverflow.com/questions/210629/python-unsigned-32-bit-bitwise-arithmetic

binaire not python
Enhancing VHDL Learning through a Light-weight Integrated Environment for Development and Automated Checking

Un logiciel client-serveur avec un ide client multi plate-formes pour apprendre le VHDL et pour noter les élèves.
Tue 18 Sep 2018 09:08:11 AM CEST - permalink -
- http://www.ece.nus.edu.sg/stfpage/eleak/pdf/akumar-tale-2013.pdf

flf simulation vhdl éducation
Verilog-mode veritedium - Verilog-mode - Veripool
Mon 17 Sep 2018 10:37:13 AM CEST - permalink -
- https://www.veripool.org/wiki/verilog-mode/verilog-mode_veritedium#SEC23

emacs flf verilog vim
My Vim Setting for verilog/systemverilog coding | Play & Go

Quelques astuces pour faire du verilog avec vim
Mon 17 Sep 2018 09:16:04 AM CEST - permalink -
- https://newbilityvery.github.io/2016/07/08/vim-env-for-rtl-coding/

emacs flf verilog vim
Build demo application from source? - HiFive1 - SiFive Forums

cd freedom-e-sdk
make software PROGRAM=led_fade
make upload PROGRAM=led_fade
Sat 15 Sep 2018 04:47:41 PM CEST - permalink -
- https://forums.sifive.com/t/build-demo-application-from-source/1607/3

C hifive1 riscv
chisel 3.1.3 | Chisel

chisel est activement maintenu, cool.
Thu 13 Sep 2018 08:50:17 PM CEST - permalink -
- https://chisel.eecs.berkeley.edu/blog/?p=204

chisel chisel3
Basics - A Gentle Introduction to Rust

Rust
Thu 13 Sep 2018 08:49:29 PM CEST - permalink -
- https://stevedonovan.github.io/rust-gentle-intro/1-basics.html

introduction rust tutoriel
OpenNews

Au delas du coté religieux c'est aussi un problème de fichage. T'as pas nécessairement envie d’apparaître dans les fichiers de l'église.
Thu 13 Sep 2018 01:08:35 PM CEST - permalink -
- https://www.ecirtam.net/opennews/?aOpvKA

cnil liberté-informatique religion
Pourquoi les mecs préfèrent les mecs – Le Mecxpliqueur

“il n’y a rien de plus pédé qu’un hétéro”. C’est vrai que tous ces mecs qui passent leur temps entre eux, quand même, c’est un peu pédé, non ?
Thu 13 Sep 2018 01:02:18 PM CEST - permalink -
- https://lemecxpliqueur.wordpress.com/2018/09/11/pourquoi-les-mecs-preferent-les-mecs/

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