Coude

Le modèle UVVM devient open-source

Du VHDL au cinéma !

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Un cours très complet sur Chisel et scala. Chisel est le nouveau langage «synthétisable par construction» qui doit envoyer VHDL et Verilog aux oubliettes de l'électronique ;)

Créer un esclave Avalon-MM en VHDL

Un language de description hardware basé sur Haskell permettant de simuler ses composants en Haskell pure. Permet aussi de générer le design synthétisable en VHDL.

Un petit outils pour convertir du vhdl en verilog

Liste des logiciels pour l'électronique inclus dans la distribution Fedora.

Une version plus récente du convertisseur VHDL vers verilog

Pour faire «à la doxygen»

J'adore les commentaires sur les outils xilinx ;)
Et là on est sur le forum officiel Xilinx !