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chisel3
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Chisel a quick reference guide for beginner
Tue Apr 14 10:29:52 2020 - permalink
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https://docs.google.com/viewer?a=v&pid=forums&srcid=MTQ0NzQ0ODU1OTAwNzkzMjE5NTQBMDE2MDg4MjA0NjQ2Njc2Mzc1MDUBaXpmWk1RR2NBQUFKATAuMQEBdjI&authuser=0
chisel
chisel3
flf
pdf
reference-manual
A Chisel Backend for Timing Predictability - Mihail Asavoae
Tiens, le CEA semble s'intéresser à Chisel. Ils ont envoyé quelqu'un faire une présentation au CCC2020.
Et ils ont une offre de stage sur le sujet :
https://www.linkedin.com/jobs/view/1717229029/
La présentation sur le site officiel du CCC:
https://events.linuxfoundation.org/chisel-community-conference/program/schedule/
Wed Feb 12 10:36:30 2020 - permalink
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https://drive.google.com/file/d/1_Cgqa3fUzamzoBp7mH6VcuuKvI74fO8v/view
cea
chisel
chisel3
flf
Vim FIRRTL syntax config
To have beautiful colors in vim with FIRRTL
Fri Feb 7 14:28:50 2020 - permalink
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https://github.com/azidar/firrtl-syntax
chisel
chisel3
firrtl
flf
vim
Diplomatic Design Patterns
Une présentation de Diplomacy, le module Chisel permettant de gérer les paramètres dans le Rocket-chip.
Thu Oct 10 09:22:12 2019 - permalink
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https://carrv.github.io/2017/slides/cook-diplomacy-carrv2017-slides.pdf
chisel
chisel3
diplomacy
riscv
Get STEP value with PeekPokeTester in Chisel3
To get time (step) simply use 't'.
```
class MyTest (dut: MyModule) extends PeekPokeTester(dut) {
step(1)
println("Step value is " + t)
...
```
Fri Sep 20 15:07:11 2019 - permalink
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https://github.com/freechipsproject/chisel-testers/blob/master/src/main/scala/chisel3/iotesters/PeekPokeTester.scala#L82
chisel
chisel3
flf
hdl
Digital Design with Chisel | Front de Libération des FPGA
Petite revue du Livre de Martin Schoeberl
Tue Sep 10 22:00:30 2019 - permalink
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http://www.fabienm.eu/flf/digital-design-with-chisel/
book
chisel
chisel3
flf
hdl
livre
Advanced Chisel Topics 2017
Jonathan Bachrach, Adam Izraelevitz, Jack Koenig
EECS UC Berkeley
January 31, 2017
Tue Sep 10 15:26:30 2019 - permalink
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http://www-inst.eecs.berkeley.edu/~cs250/sp17/handouts/advanced-chisel.pdf
chisel
chisel3
flf
pdf
tutoriel
chisel 3.1.5 | Chisel
Deux versions de chisel dans la même journée !
https://chisel.eecs.berkeley.edu/blog/?p=209
Sat Dec 15 14:22:22 2018 - permalink
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https://chisel.eecs.berkeley.edu/blog/?p=211
chisel
chisel3
flf
chisel 3.1.3 | Chisel
chisel est activement maintenu, cool.
Thu Sep 13 20:50:17 2018 - permalink
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https://chisel.eecs.berkeley.edu/blog/?p=204
chisel
chisel3
generator-bootcamp
Oubliez le chisel-tutorial, passez au generator-bootcamp.
Wed Aug 29 11:20:04 2018 - permalink
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https://github.com/ucb-bar/generator-bootcamp
chisel
chisel3
flf
fpga
hdl
chisel - How to do a vector of modules? - Stack Overflow
Tue Jun 5 21:17:22 2018 - permalink
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https://stackoverflow.com/questions/33621533/how-to-do-a-vector-of-modules#33624086
chisel
chisel3
flf
module
vector
Release note de Chisel 3.0.0
Qui y a-t-il dans la nouvelle release de Chisel 3.0.0 ? Beaucoup de chose permettant de dire que Chisel est maintenant un langage HDL mature.
Sat Nov 25 20:45:54 2017 - permalink
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https://github.com/freechipsproject/chisel3/releases/tag/v3.0.0
chisel
chisel3
flf
fpga
hdl
chisel 3.0.0-RC1 | Chisel
Sortie de la RC1 de Chisel 3.0.0. Première version de chisel 3 à être supporté par le RISC-V Rocket Chip Generator
Tue Oct 31 08:02:00 2017 - permalink
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https://chisel.eecs.berkeley.edu/blog/?p=173
chisel
chisel3
riscv
scala
Les BlackBox et RawModule de Chisel3 | Front de Libération des FPGA
Un nouvel article sur le site du FLF pour Chisel3.
Wed Apr 5 14:44:39 2017 - permalink
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http://www.fabienm.eu/flf/les-blackbox-et-rawmodule-de-chisel3/
chisel
chisel3
flf
fpga
HDL
Chisel 3 wiki
Il y a un Wiki pour Chisel 3. Espérons que ça complétera bien la documentation officielle qui est un peu light.
Thu Nov 3 13:29:30 2016 - permalink
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https://github.com/ucb-bar/chisel3/wiki
chisel
chisel3
documentation
flf
wiki
chisel3 announcement | Chisel
Ça y est, première release de Chisel3. Un langage HDL Synthétisable Synchrone basé sur Scala.
Thu Nov 3 09:11:17 2016 - permalink
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https://chisel.eecs.berkeley.edu/blog/?p=156
chisel
chisel3
flf
fpga
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