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La branche gatemate de nextpnr
Une doc de CologneChip sur comment s'interfacer en 3v3 avec son FPGA
Ho, Un projet de portage du gatemate sur NextPnR !
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Un projet d'exemple en Clash
Un HDL qui ne donne pas envie de s'arracher les cheveux. Inspiré de Rust et Clash. Hmm à voir.
This repository shows how to convert a complex VHDL design into a single, synthesizable, plain-Verilog module using GHDL's synthesis feature.
Appeler du python depuis du SystemVerilog.
Une carte de développement FPGA (ICE40) au format ... microsd !
Un analyseur syntaxique VHDL écrit en rust. Disponible pour VSCode, Emacs, NeoVim, ...
Un cours complet sur l'analyse static des timings.
Renesas SLG7EVBFORGE FPGA dev board, built around SLG47910V is Renesas' first low-density FPGA in the ForgeFPGA family. The FPGA includes 1120 LUTs, 1120
Un petit tutoriel de Adam Taylor sur l'utilisation de l'analyseur logique intégré de CologneChip pour le Gatemate.
Oak Development Technologies’ RPGA Feather board integrates the Raspberry Pi RP2040 microcontroller with the iCE5LP4K FPGA from Lattice Semiconductor into
Un concept de tetris où les briques «tombent» du coté droit et gauche de l'écran en même temps et où il faut faire des lignes verticales.
Une «sonde de debug» pour le FPGA opensource basée sur Amaranth.
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